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  /external/u-boot/arch/arm/include/asm/arch-rockchip/
cru_rk3188.h 170 APLL_MODE_MASK = 3,
cru_rk3036.h 97 APLL_MODE_MASK = 1 << APLL_MODE_SHIFT,
cru_rk3128.h 106 APLL_MODE_MASK = 1 << APLL_MODE_SHIFT,
cru_rk322x.h 104 APLL_MODE_MASK = 1 << APLL_MODE_SHIFT,
cru_rk3288.h 196 APLL_MODE_MASK = CRU_MODE_MASK << APLL_MODE_SHIFT,
  /external/u-boot/drivers/clk/rockchip/
clk_rk3036.c 86 GPLL_MODE_MASK | APLL_MODE_MASK,
163 GPLL_MODE_MASK | APLL_MODE_MASK,
181 0xffffffff, APLL_MODE_MASK, DPLL_MODE_MASK, 0xffffffff,
clk_rk3128.c 148 GPLL_MODE_MASK | APLL_MODE_MASK,
225 GPLL_MODE_MASK | APLL_MODE_MASK | CPLL_MODE_MASK,
250 0xff, APLL_MODE_MASK, DPLL_MODE_MASK, CPLL_MODE_MASK,
clk_rk3188.c 198 rk_clrsetreg(&cru->cru_mode_con, APLL_MODE_MASK << APLL_MODE_SHIFT,
218 rk_clrsetreg(&cru->cru_mode_con, APLL_MODE_MASK << APLL_MODE_SHIFT,
240 switch ((con >> shift) & APLL_MODE_MASK) {
clk_rk322x.c 87 GPLL_MODE_MASK | APLL_MODE_MASK,
164 GPLL_MODE_MASK | APLL_MODE_MASK,
182 0xff, APLL_MODE_MASK, DPLL_MODE_MASK, 0xff,
clk_rk3288.c 453 rk_clrsetreg(&cru->cru_mode_con, APLL_MODE_MASK,
487 rk_clrsetreg(&cru->cru_mode_con, APLL_MODE_MASK,

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