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/bionic/libc/kernel/uapi/drm/
i810_drm.h
195
#define DRM_IOCTL_I810_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLUSH)
196
#define DRM_IOCTL_I810_GETAGE
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_GETAGE)
199
#define DRM_IOCTL_I810_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_SWAP)
201
#define DRM_IOCTL_I810_DOCOPY
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_DOCOPY)
204
#define DRM_IOCTL_I810_FSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FSTATUS)
205
#define DRM_IOCTL_I810_OV0FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_OV0FLIP)
207
#define DRM_IOCTL_I810_RSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_RSTATUS)
209
#define DRM_IOCTL_I810_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLIP)
r128_drm.h
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#define DRM_IOCTL_R128_CCE_START
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_START)
150
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DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_RESET)
151
#define DRM_IOCTL_R128_CCE_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_IDLE)
152
#define DRM_IOCTL_R128_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_RESET)
154
#define DRM_IOCTL_R128_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_SWAP)
167
#define DRM_IOCTL_R128_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_FLIP)
drm.h
459
#define
DRM_IO
(nr) _IO(DRM_IOCTL_BASE,nr)
499
#define DRM_IOCTL_SET_MASTER
DRM_IO
(0x1e)
500
#define DRM_IOCTL_DROP_MASTER
DRM_IO
(0x1f)
520
#define DRM_IOCTL_AGP_ACQUIRE
DRM_IO
( 0x30)
521
#define DRM_IOCTL_AGP_RELEASE
DRM_IO
( 0x31)
radeon_drm.h
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#define DRM_IOCTL_RADEON_CP_START
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_START)
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DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESET)
481
#define DRM_IOCTL_RADEON_CP_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_IDLE)
482
#define DRM_IOCTL_RADEON_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_RESET)
485
#define DRM_IOCTL_RADEON_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_SWAP)
497
#define DRM_IOCTL_RADEON_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_FLIP)
505
#define DRM_IOCTL_RADEON_CP_RESUME
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESUME)
[
all
...]
mga_drm.h
186
#define DRM_IOCTL_MGA_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_MGA_RESET)
187
#define DRM_IOCTL_MGA_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_MGA_SWAP)
/external/kernel-headers/original/uapi/drm/
i810_drm.h
215
#define DRM_IOCTL_I810_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLUSH)
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DRM_IO
( DRM_COMMAND_BASE + DRM_I810_GETAGE)
218
#define DRM_IOCTL_I810_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_SWAP)
220
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DRM_IO
( DRM_COMMAND_BASE + DRM_I810_DOCOPY)
222
#define DRM_IOCTL_I810_FSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FSTATUS)
223
#define DRM_IOCTL_I810_OV0FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_OV0FLIP)
225
#define DRM_IOCTL_I810_RSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_RSTATUS)
226
#define DRM_IOCTL_I810_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLIP)
r128_drm.h
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DRM_IO
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DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_RESET)
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DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_IDLE)
205
#define DRM_IOCTL_R128_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_RESET)
206
#define DRM_IOCTL_R128_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_SWAP)
218
#define DRM_IOCTL_R128_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_FLIP)
drm.h
660
#define
DRM_IO
(nr) _IO(DRM_IOCTL_BASE,nr)
697
#define DRM_IOCTL_SET_MASTER
DRM_IO
(0x1e)
698
#define DRM_IOCTL_DROP_MASTER
DRM_IO
(0x1f)
717
#define DRM_IOCTL_AGP_ACQUIRE
DRM_IO
( 0x30)
718
#define DRM_IOCTL_AGP_RELEASE
DRM_IO
( 0x31)
radeon_drm.h
515
#define DRM_IOCTL_RADEON_CP_START
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_START)
517
#define DRM_IOCTL_RADEON_CP_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESET)
518
#define DRM_IOCTL_RADEON_CP_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_IDLE)
519
#define DRM_IOCTL_RADEON_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_RESET)
521
#define DRM_IOCTL_RADEON_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_SWAP)
531
#define DRM_IOCTL_RADEON_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_FLIP)
537
#define DRM_IOCTL_RADEON_CP_RESUME
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESUME)
[
all
...]
/prebuilts/gcc/linux-x86/host/x86_64-linux-glibc2.11-4.6/sysroot/usr/include/drm/
i810_drm.h
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DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLUSH)
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DRM_IO
( DRM_COMMAND_BASE + DRM_I810_GETAGE)
218
#define DRM_IOCTL_I810_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_SWAP)
220
#define DRM_IOCTL_I810_DOCOPY
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_DOCOPY)
222
#define DRM_IOCTL_I810_FSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FSTATUS)
223
#define DRM_IOCTL_I810_OV0FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_OV0FLIP)
225
#define DRM_IOCTL_I810_RSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_RSTATUS)
226
#define DRM_IOCTL_I810_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLIP)
r128_drm.h
200
#define DRM_IOCTL_R128_CCE_START
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_START)
202
#define DRM_IOCTL_R128_CCE_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_RESET)
203
#define DRM_IOCTL_R128_CCE_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_IDLE)
205
#define DRM_IOCTL_R128_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_RESET)
206
#define DRM_IOCTL_R128_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_SWAP)
218
#define DRM_IOCTL_R128_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_FLIP)
i830_drm.h
270
#define DRM_IOCTL_I830_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_FLUSH)
271
#define DRM_IOCTL_I830_GETAGE
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_GETAGE)
273
#define DRM_IOCTL_I830_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_SWAP)
275
#define DRM_IOCTL_I830_DOCOPY
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_DOCOPY)
276
#define DRM_IOCTL_I830_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_FLIP)
drm.h
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#define
DRM_IO
(nr) _IO(DRM_IOCTL_BASE,nr)
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DRM_IO
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DRM_IO
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DRM_IO
( 0x30)
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DRM_IO
( 0x31)
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#define DRM_IOCTL_I915_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_FLUSH)
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DRM_IO
( DRM_COMMAND_BASE + DRM_I915_FLIP)
215
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DRM_IO
( DRM_COMMAND_BASE + DRM_I915_GEM_THROTTLE)
216
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DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_ENTERVT)
217
#define DRM_IOCTL_I915_GEM_LEAVEVT
DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_LEAVEVT)
radeon_drm.h
514
#define DRM_IOCTL_RADEON_CP_START
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_START)
516
#define DRM_IOCTL_RADEON_CP_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESET)
517
#define DRM_IOCTL_RADEON_CP_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_IDLE)
518
#define DRM_IOCTL_RADEON_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_RESET)
520
#define DRM_IOCTL_RADEON_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_SWAP)
530
#define DRM_IOCTL_RADEON_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_FLIP)
536
#define DRM_IOCTL_RADEON_CP_RESUME
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESUME)
/prebuilts/gcc/linux-x86/host/x86_64-linux-glibc2.11-4.8/sysroot/usr/include/drm/
i810_drm.h
215
#define DRM_IOCTL_I810_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLUSH)
216
#define DRM_IOCTL_I810_GETAGE
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_GETAGE)
218
#define DRM_IOCTL_I810_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_SWAP)
220
#define DRM_IOCTL_I810_DOCOPY
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_DOCOPY)
222
#define DRM_IOCTL_I810_FSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FSTATUS)
223
#define DRM_IOCTL_I810_OV0FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_OV0FLIP)
225
#define DRM_IOCTL_I810_RSTATUS
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_RSTATUS)
226
#define DRM_IOCTL_I810_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I810_FLIP)
r128_drm.h
200
#define DRM_IOCTL_R128_CCE_START
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_START)
202
#define DRM_IOCTL_R128_CCE_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_RESET)
203
#define DRM_IOCTL_R128_CCE_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_IDLE)
205
#define DRM_IOCTL_R128_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_RESET)
206
#define DRM_IOCTL_R128_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_SWAP)
218
#define DRM_IOCTL_R128_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_FLIP)
i830_drm.h
270
#define DRM_IOCTL_I830_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_FLUSH)
271
#define DRM_IOCTL_I830_GETAGE
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_GETAGE)
273
#define DRM_IOCTL_I830_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_SWAP)
275
#define DRM_IOCTL_I830_DOCOPY
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_DOCOPY)
276
#define DRM_IOCTL_I830_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_IOCTL_I830_FLIP)
drm.h
614
#define
DRM_IO
(nr) _IO(DRM_IOCTL_BASE,nr)
649
#define DRM_IOCTL_SET_MASTER
DRM_IO
(0x1e)
650
#define DRM_IOCTL_DROP_MASTER
DRM_IO
(0x1f)
666
#define DRM_IOCTL_AGP_ACQUIRE
DRM_IO
( 0x30)
667
#define DRM_IOCTL_AGP_RELEASE
DRM_IO
( 0x31)
i915_drm.h
194
#define DRM_IOCTL_I915_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_FLUSH)
195
#define DRM_IOCTL_I915_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_FLIP)
215
#define DRM_IOCTL_I915_GEM_THROTTLE
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_GEM_THROTTLE)
216
#define DRM_IOCTL_I915_GEM_ENTERVT
DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_ENTERVT)
217
#define DRM_IOCTL_I915_GEM_LEAVEVT
DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_LEAVEVT)
radeon_drm.h
514
#define DRM_IOCTL_RADEON_CP_START
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_START)
516
#define DRM_IOCTL_RADEON_CP_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESET)
517
#define DRM_IOCTL_RADEON_CP_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_IDLE)
518
#define DRM_IOCTL_RADEON_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_RESET)
520
#define DRM_IOCTL_RADEON_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_SWAP)
530
#define DRM_IOCTL_RADEON_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_FLIP)
536
#define DRM_IOCTL_RADEON_CP_RESUME
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESUME)
/hardware/intel/img/libdrm/shared-core/
mach64_drm.h
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#define DRM_IOCTL_MACH64_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_MACH64_IDLE )
168
#define DRM_IOCTL_MACH64_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_MACH64_RESET )
169
#define DRM_IOCTL_MACH64_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_MACH64_SWAP )
173
#define DRM_IOCTL_MACH64_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_MACH64_FLUSH )
r128_drm.h
200
#define DRM_IOCTL_R128_CCE_START
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_START)
202
#define DRM_IOCTL_R128_CCE_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_RESET)
203
#define DRM_IOCTL_R128_CCE_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_CCE_IDLE)
205
#define DRM_IOCTL_R128_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_RESET)
206
#define DRM_IOCTL_R128_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_SWAP)
218
#define DRM_IOCTL_R128_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_R128_FLIP)
i915_drm.h
211
#define DRM_IOCTL_I915_FLUSH
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_FLUSH)
233
#define DRM_IOCTL_I915_GEM_THROTTLE
DRM_IO
( DRM_COMMAND_BASE + DRM_I915_GEM_THROTTLE)
234
#define DRM_IOCTL_I915_GEM_ENTERVT
DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_ENTERVT)
235
#define DRM_IOCTL_I915_GEM_LEAVEVT
DRM_IO
(DRM_COMMAND_BASE + DRM_I915_GEM_LEAVEVT)
radeon_drm.h
511
#define DRM_IOCTL_RADEON_CP_START
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_START)
513
#define DRM_IOCTL_RADEON_CP_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESET)
514
#define DRM_IOCTL_RADEON_CP_IDLE
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_IDLE)
515
#define DRM_IOCTL_RADEON_RESET
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_RESET)
517
#define DRM_IOCTL_RADEON_SWAP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_SWAP)
527
#define DRM_IOCTL_RADEON_FLIP
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_FLIP)
533
#define DRM_IOCTL_RADEON_CP_RESUME
DRM_IO
( DRM_COMMAND_BASE + DRM_RADEON_CP_RESUME)
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